チップ単価計算ツール(ウェハ価格 ÷ 良品数)
最終更新:2026-09-21
要点
チップ1個のシリコン代は「ウェハ価格 ÷(取れ数 × 歩留まり)」で決まります。チップ面積を2倍にすると取れ数はほぼ半分になり、同時に歩留まりも下がるため、単価は2倍以上に跳ね上がります。先端ノードほどウェハ価格が高く欠陥密度も高いので、大型ダイほど不利になります。AI向けGPUなどがチップレット化へ向かうのはこのためです。
入力
良品チップ1個あたりのコスト199ドル
うちシリコン代(ウェハ価格÷良品数)199ドル
取れ数(DPW)148個
歩留まり(Murphyモデル)67.9%
良品ダイ数100個/枚
プリセットのウェハ価格は、ファウンドリの公式価格ではなく報道や調査会社の推定値をもとにした概数です。実際の価格は顧客・数量・契約時期で大きく変わるため、比較の目安として使ってください。組立・テスト費はパッケージ形態で数十セントから数百ドルまで幅があるので、既定値は0にしています。
チップレットに分割した場合のシリコン代
| 分割数 | 1個の寸法 | 取れ数 | 歩留まり | 1個の単価 | N個の合計 |
|---|---|---|---|---|---|
| 1(モノリシック) | 20.0×20.0 mm | 148 | 67.9 % | 199 ドル | 199 ドル |
| 2 分割 | 10.0×20.0 mm | 299 | 82.1 % | 81.43 ドル | 163 ドル |
| 4 分割 | 10.0×10.0 mm | 612 | 90.6 % | 36.09 ドル | 144 ドル |
| 8 分割 | 5.0×10.0 mm | 1,236 | 95.1 % | 17.01 ドル | 136 ドル |
分割するとダイが小さくなるので歩留まりが上がり、不良で捨てるシリコンが減ります。その一方で、実際のチップレットではダイ間接続(PHY)の面積が各ダイに加わり、2.5D/3Dパッケージの費用と組立歩留まりが上乗せされます。表の合計がモノリシックより安くても、パッケージ費用まで含めて逆転するかどうかが判断の分かれ目です。
チップ単価はどう決まるか
チップ1個のシリコン代は「ウェハ1枚の価格 ÷ 1枚から取れる良品の数」で決まります。分母の良品数は取れ数(DPW)と歩留まりの積で、どちらもチップ面積が大きくなるほど悪化します。面積を2倍にすると取れ数はおよそ半分になり、同時に歩留まりも下がるため、チップ単価は面積の2倍以上に跳ね上がります。
先端ノードほどウェハ価格が高く、立ち上げ初期は欠陥密度も高いので、大型ダイのコストは急激に増えます。AI向けGPUのようにレチクル上限(約26×33mm)に近いチップがチップレット化へ向かうのは、この計算が理由です。